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基于DSP的SAW RFID系统的设计及应用

基于DSP的SAW RFID系统的设计及应用[嵌入式技术][安防电子]

基于SAW标签的RFID系统弥补了传统基于IC标签的RFID系统易受环境干扰的缺点,可在高温差、强电磁干扰等恶劣环境下使用。介绍了整个SAW RFID系统的设计方案,详细说明SAW标签及零中频阅读器的工作原理和设计过程。通过电路调试与软件仿真,验证了基于DSP的SAW RFID系统的可行性。该系统具有性能稳定、效果良好和性价比高等特点,在矿井安全监控等许多领域有较好的应用价值。

发表于:2014/3/21 下午2:04:00

基于TTCN-3的异系统间小区切换的测试

基于TTCN-3的异系统间小区切换的测试[通信与网络][其他]

对TD-LTE与TD-SCDMA系统间的小区切换问题进行了深入研究,设计了相应的测试流程,提出了一种基于TTCN-3的测试系统实现方案,完成了对TD-LTE与TD-SCDMA系统间小区切换的测试。

发表于:2014/3/21 下午1:12:00

基于FPGA的激光陀螺信号高速解调滤波设计

基于FPGA的激光陀螺信号高速解调滤波设计[可编程逻辑][物联网]

在FPGA中实现DSP和计算机常用的IEEE单精度32位浮点表示方式,通过模块化设计,能够进行相关的浮点加法和乘法操作。利用内部逻辑单元、乘法器、ROM、RAM等资源,经过正确的逻辑控制和可靠的时序设计,设计了一个能对激光陀螺信号进行高速、精确滤波的专用滤波器,并且更简便实现后续DSP或计算机对滤波数据的格式处理。

发表于:2014/3/20 下午3:31:00

一种基于ARM的集中器的硬件实现

一种基于ARM的集中器的硬件实现[嵌入式技术][智能电网]

介绍了一种以ARM9为核心,以Windows CE5.0为操作系统的集中器。它符合国家电网的Q/GDW 374.2-2009技术标准,可以在国家电网中使用。给出了集中器的系统框图,介绍了集中器的主要实现电路,论述了其主要工作原理。

发表于:2014/3/20 下午3:31:00

可穿戴式人体呼吸状态监测系统的设计

可穿戴式人体呼吸状态监测系统的设计[嵌入式技术][医疗电子]

设计了一种基于蓝牙的可穿戴式睡眠呼吸暂停低通气综合征监测装置,通过该装置可以实时检测到睡眠呼吸暂停低通气综合征病人的睡眠呼吸状态。可穿戴技术实现基本生理信号的低负荷获取;蓝牙实现呼吸数据短距离无线传输且方便与PDA 或Android智能手机等手持终端通信,保证了对病人的连续实时监测。

发表于:2014/3/20 下午3:30:00

分布式MIMO CR系统预编码与功率分配的联合优化

分布式MIMO CR系统预编码与功率分配的联合优化[通信与网络][通信网络]

分布式MIMO CR系统中,构建多用户功率分配的非合作博弈模型,使认知用户速率达到均衡状态。受授权用户和多用户干扰的影响,认知用户速率很难达到理想值。为了解决上述问题,在发射端设置了适用于不同约束条件的预编码矩阵,提出了预编码与功率分配的联合优化算法。仿真结果表明,基于块对角化的联合优化算法,有效消除用户之间的信道干扰,显著提高了认知用户速率。

发表于:2014/3/20 下午2:29:00

基于STM32的电能手抄系统设计与实现

基于STM32的电能手抄系统设计与实现[嵌入式技术][其他]

综合考虑目前抄表系统在实际应用中的一些弊端, 介绍了一种基于STM32并嵌入μC/OS-II实时操作系统的电能手抄系统的设计与实现方案。该系统采用JF24C无线通信模块,并对多功能电能表通信规约DL/T 645-2007协议进行解析和转换。最后,通过测试表明该手抄系统能够快速准确地完成对电能表数据的采集和传输等功能。

发表于:2014/3/20 上午9:40:00

电缆故障源有效冲击放电信号测量电路设计

电缆故障源有效冲击放电信号测量电路设计[测试测量][工业自动化]

信号测量电路是对故障源在有效冲击放电条件下,实现发出的声信号的去干扰,快速精确测量。首先对有效冲击放电进行简要阐述,然后说明声传感器的选择和工作原理。在强干扰条件下,针对弱信号进行检测,设计具有高输入阻抗、低输出阻抗、低噪声的前置放大电路,通过带通滤波器选择被测信号,滤除干扰信号。最后,采样AD8337实现信号的自动增益控制,获得稳定、低噪声的信号输出。

发表于:2014/3/19 下午2:40:00

面向CBC模式的AES高速芯片设计与实现

面向CBC模式的AES高速芯片设计与实现[通信与网络][通信网络]

为以硬件方式高速实现AES密码算法,缩短整个芯片的关键路径,基于一种改进AES密码算法,在算法级对电路实现进行优化,将AES密码算法中字节代替变换与列混合变换进行合并,以查找表的方式实现这两种变换的一步变换。在支持密钥长度为128 bit、192 bit和256 bit AES算法的同时,支持分组密码工作中的ECB,CBC模式,提高了分组密码不同级别的安全性。在0.13 μm CMOS工艺下,用Verilog硬件描述语言进行综合,仿真结果表明最高时钟频率可以达到781 MHz,在密钥长度分别为128 bit、192 bit和256 bit时,最大数据吞吐率分别可以达到9.9 Gb/s、8.3 Gb/s和7.1 Gb/s,占用面积38.5 KGates。

发表于:2014/3/19 下午2:01:00

双基地雷达目标速度计算的FPGA实现

双基地雷达目标速度计算的FPGA实现[可编程逻辑][其他]

为了解决双基地雷达目标速度计算复杂的问题,基于CORDIC算法并利用FPGA设计了双基地雷达目标速度计算模块。仿真结果表明,所设计的双基地雷达目标速度计算模块计算精度高,工作速度快,资源消耗少,能很好地应用于双基地雷达中。

发表于:2014/3/19 下午2:00:00

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