头条 世界首款微处理器MP944被复活 7月27日，嵌入式系统专家亚当·泰勒使用FPGA（现场可编程门阵列）复刻F-14雄猫战斗机的中央大气数据计算机，将其装入3D打印的F-14模型中，成功控制后者的可变后掠翼系统。 该系统核心为MP944微处理器，1970年6月随F-14服役，比1971年11月问世的英特尔4004早近一年半，此前因军事保密1998年才解密，是世界首款微处理器，性能较英特尔4004快约8倍。亚当·泰勒基于Spartan 7的SoM模块复现了MP944全部六块芯片，目前该项目的全部代码和文档已公开在GitHub，供全球开发者查阅。 最新资讯 软件无线电平台可重配置接口的实现 实现了一种用于上位机和FPGA处理板之间通信的可重配置接口，详细介绍了该接口的包格式设计和FPGA逻辑设计。仿真结果表明，该可重配置接口能根据信令，实现准实时在线参数配置，满足多种主流通信体制的不同速率要求。 发表于：2010/10/9 赛灵思联手四川虹视成立FPGA联合实验室 全球可编程逻辑解决方案领导厂商赛灵思公司（Xilinx, Inc. (NASDAQ: XLNX) ），2010年9月14日宣布与四川虹视显示技术有限公司（简称四川虹视）在成都高新区共同成立FPGA联合实验室, 致力于推动虹视公司最新的OLED产品技术研发，赛灵思全球消费市场总监Harry Raftopoulos，高级技术市场经理酆毅，四川虹视总经理郎丰伟，技术总监文东星、产品研发中心部长田朝勇等出席了签字揭牌仪式。 发表于：2010/10/9 FPGA时序收敛 您编写的代码是不是虽然在仿真器中表现正常，但是在现场却断断续续出错？要不然就是有可能在您使用更高版本的工具链进行编译时，它开始出错。您检查自己的测试平台，并确认测试已经做到 100% 的完全覆盖，而且所有测试均未出现任何差错，但是问题仍然顽疾难除。 发表于：2010/10/9 基于FPGA的两种DDS实现 DDS(Direct Digital Freqiaency Synthesizers)广泛应用于雷达系统、数字通信、电子对抗、电子测量等民用军用设备中。它是随着半导体技术和数字技术的快速发展而发展起来的新型的频率合成技术，与传统的VCO+PLL的模拟方式产生所需频率相比，DDS技术具有频率分辨率高，相位噪声低，带宽较宽，频谱纯度好等优点。 发表于：2010/10/8 一种基于FPGA的锁相环位同步提取电路设计 在数字通信中，除了获取相干载波的载波同步外，位同步的提取是更为重要的一个环节。一般的位同步电路大多采用标准逻辑器件按传统数字系统设计方法构成，具有功耗大，可靠性低的缺点。用FPGA设计电路具有很高的灵活性和可靠性，可以提高集成度和设计速度，增强系统的整体性能。 发表于：2010/9/30 基于FPGA的DDFS与DDWS两种实现方式 DDS(Direct Digital Freqiaency Synthesizers)广泛应用于雷达系统、数字通信、电子对抗、电子测量等民用军用设备中。它是随着半导体技术和数字技术的快速发展而发展起来的新型的频率合成技术，与传统的VCO+PLL的模拟方式产生所需频率相比，DDS技术具有频率分辨率高，相位噪声低，带宽较宽，频谱纯度好等优点。这些技术指标在一个系统中是至关重要的，决定着一个系统的成败。 发表于：2010/9/30 基于FPGA和DDS技术的正弦信号发生器设计 对于正弦信号发生器的设计，可以采用DDS，即直接数字频率合成方案实现。DDS的输出频率是数字可调的，完全能实现频率为1 kHz～10 MHz之间的正弦信号，这是实际应用中产生可调频率正弦信号波形较为理想的方案。实现DDS常用3种技术方案：高性能DDS单片电路的解决方案；低频正弦波DDS单片电路的解决方案；自行设计的基于FPGA芯片的解决方案。虽然有的专用DDS芯片的功能也比较多，但控制方式却是固定的，因此不一定满足用户需求。而基于FPGA则可以根据需要方便地实现各种比较复杂的调频、调相和调幅功能，具有良好的实用性。专用DDS芯片由于采用特定的集成工艺，内部数字信号抖动很小，可以输出高质量的模拟信号；利用FPGA也能输出较高质量的信号，虽然达不到专用DDS芯片的水平，但信号精度误差非常小，能满足大多数信号源要求。 发表于：2010/9/30 基于FPGA的按键弹跳消除模块的研究与应用 按键在数字电路设计中经常用到。按键的弹跳现象是数字系统设计中存在的客观问题。按键是机械触点，当接触点断开或闭合时会产生抖动。为使每一次按键只做一次响应，就必须去除抖动。本文对按键的抖动信号进行了分析，并通过计数器的方式完成了消除抖动电路模块的设计。把该模块应用到按键控制LCD显示的系统中，并在Memec代理的Virtex-4 MB系统实验板上实现了该系统。消抖电路的效果良好，按键控制LCD显示结果正常。 发表于：2010/9/30 基于FPGA的并行DDS 介绍一种提高直接数字合成器（DDS）系统时钟频率的并行处理方法。给出了一个基于现场可编程门阵列（FPGA）的具有400MHz系统时钟频率DDS电路的实现方法和实验测试结果。采用直接中频输出方式，输出频率范围250MHz～350MHz，频率分辨率6Hz，寄生信号抑制50dB。该DDS电路具有接口简单、使用灵活等优点，可用于雷达、电子战领域的宽带信号产生。 发表于：2010/9/30 直接数字频率合成器DDS的优化设计 在深入理解DDS基本原理的基础上，采用多级流水线控制技术对DDS的VHDL语言实现进行了优化，并进行了异步接口的同步化设计，给出了DDS系统的时序仿真结果及其在FPGA中的资源占有率。 发表于：2010/9/30 <…459460461462463464465466467468…>
